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skill问题

848 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:19

有谁能正式成功破解cadence SPB16.5的？

857 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:19

Cadence原理图设计用concept hdl 还是用capture cis

1217 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:19

[下载]★中兴通讯的PCB设计规范（Word文档）★

1802 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:19

求救：win7标准用户下drc walk不能加载

994 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:17

求大家帮忙把allegro pcb文件转成protel 99 se 格式

993 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:17

[分享]what's the new Orcad 16.0 ?

1026 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:16

快捷线宽设置命令

1087 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:15

ALLEGO中的情人[BMP图导入到ALLEGRO工具下载]

2227 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:15

关于skill的问题。

1211 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:14

Cadence15.7license的过期问题终于解决啦！

977 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:14

大家新年好！新年第一期Allegro高速PCB设计培新开始了，名额有限

1079 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:13

元件的接地通孔铺成梅花、VIA全覆

1190 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:13

Allegro中Swap功能的使用之一（新转法篇）

2051 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:13

BGA layout

1159 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:13

怎样在allegro中出拼板数据，望各位牛人告知．

1183 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:12

Cadence 16.5 PCB Edit 新功能

1099 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:12

Cadence 16.5 PCB Edit 新功能连载（二）.pdf

1147 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:12

请问有关修改Value值的问题

1167 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:11

pcb与原理图同步的问题

1150 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:11

net logic 后跟原理图保持一致

1371 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:11

反标的问题

1170 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:11

【大家来投票】用Allegro时，做封装以及Layout分别用什么单位？

1417 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:11

求助如下图

1031 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:10

信号完整性基础知识(中兴通信)

929 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:10

[分享]小结：如何在Allegro Layout中显示元件Value值

1257 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:10

skill做封装的好帮手

1268 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:09

orcad生成allegro网表的那个allegro.dll文件谁有嘛？

1160 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:09

使用 OrCAD-Allegro 工具链时的黄金准则

879 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:09

Cadence 16.5卸载后无法再安装

1388 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:09

器件间距问题

1445 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:09

[求助]高亮或选择一条走线时如何让整条线成一种颜色？

1095 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:08

请教：椭圆孔NC Drill失败！[附图]

1352 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:08

导出网表出的错误，帮帮忙！

2963 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:08

PADSTACK制作标准规格

1125 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:08

走差分线出现的问题

1136 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:08

请问一下,什么软件能输入.356的文件,并能输出IPC-D-356A的文件。

1184 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:07

ALLEGRO 约束规则设置步骤（以DDR 为例）

993 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:07

spb16.3 如何安装补丁？

1217 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:07

中兴通讯：印制电路板设计规范 ——SMD 元器件封装库尺寸要求

1295 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:06

allegro 移动的问题

927 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:06

请问AD的原理图可否转为ORCAD格式？如何转？

1097 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:06

SI9000各阻抗计算说明

1299 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:06

请求帮助 ORCAD生成网表报错

9181 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:05

刚学习想问个安装孔的问题

1020 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:05

skill程序解密研究

2139 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:05

CADENCE原理图与PCB设计说明

1115 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:05

Design Entry HDL原理图分册教程

2421 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:04

DDR2布线的一些资料，比较有用吧！

1241 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:04

PCB设计技巧

1268 0 ad*** 2012-9-8 发表 最后回复于 2012-9-8 00:03

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