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net logic 后跟原理图保持一致

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比如FPGA的引脚要拉到外面，现在只在PFGA上面标了网络，然后在PCB中用NET LOGIC把FPGA的网络分配到外面，完了以后可以看到它们之间有鼠线相连，但是没有办法跟原理图联系，import logic后又不相连了，有什么办法跟原理图同步吗？把pcb中assign的网络反标到原理图中

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