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J-K触发器构成分频、计数电路图

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图A所示是用CMOS电路J-K触发器构成的除2加法计数线路,表A是颇┞锋值表。
  图B所示是除3加法计数线路,表B是颇┞锋值表。
   ET477042010092422002612011061018441012178.jpg
   ET477042010092422002622011061018441012179.jpg
   ET477042010092422002632011061018441012180.jpg
   ET477042010092422002642011061018441012181.jpg
   ET477042010092422002652011061018441012182.jpg
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   ET477042010092422002672011061018441012184.jpg
   ET477042010092422002682011061018441012185.jpg
   ET477042010092422002692011061018441012186.jpg
   ET4770420100924220026102011061018441012187.jpg

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